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공지사항1

시작 안녕하세요. RTLog 입니다. 하드웨어 기술 언어인 Verilog-HDL를 사용하여 여러가지 IP를 설계하고 공부한 내용들을 기록해보려고 합니다. 디지털 신호 처리 IP들을 주로 다루고, 영상처리, 인터페이스 IP 등은 기회가 된다면 개인 공부용으로 진행해볼게요. 이외에도, 잡다한 내용들을 작성할 예정입니다. 많은 관심 가져주시면 감사하겠습니다~! 2024. 2. 3.
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